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沙特KAUST李曉航團隊:STO新型制備工藝實現2.3微米超小尺寸深紫外Micro-LED

日期:2025-06-17 閱讀:371
核心提示:近日,沙特阿卜杜拉國王科技大學(KAUST)先進半導體實驗室團隊在深紫外(DUV)Micro-LED制造領域取得重要進展。研究團隊首次提出并驗證了一種基于選擇性熱氧化(Selective Thermal Oxidation, STO)的“自對準”像素化制造工藝,成功實現像素尺寸僅為2.3微米的獨立式與陣列式DUV Micro-LED器件。相關成果已發表在光學領域權威期刊 Optics Letters 上。

 近日,沙特阿卜杜拉國王科技大學(KAUST)先進半導體實驗室團隊在深紫外(DUV)Micro-LED制造領域取得重要進展。研究團隊首次提出并驗證了一種基于選擇性熱氧化(Selective Thermal Oxidation, STO)的“自對準”像素化制造工藝,成功實現像素尺寸僅為2.3微米的獨立式與陣列式DUV Micro-LED器件。相關成果已發表在光學領域權威期刊 Optics Letters 上。

 

圖一. 采用 (a) 反應離子刻蝕和 (b)選擇性熱氧化技術進行 Micro-LED制造的工藝流程。

背景闡述

如圖1(a)所示,在基于反應離子刻蝕(RIE)的傳統Micro-LED制造工藝中,首先通過RIE形成Micro-LED臺面結構,隨后需進行絕緣材料沉積,如SiO2 和 Al2O3等,以實現側壁鈍化并隔離n型與p型電極。接下來,通過光刻和刻蝕在臺面絕緣材料上開孔,暴露p-GaN表面,用以后續p接觸形成。在此過程中,高精度的光刻和套刻對準從而精確的把控孔徑的位置是至關重要的。這將確保在開孔后,n 型材料和臺面側壁仍然被絕緣材料覆蓋。若對準發生嚴重偏差,則開孔后n 型材料和臺面側壁表面絕緣材料殘缺,金屬p電極將可能與n型材料或側壁直接接觸,導致器件漏電甚至短路失效(如圖1(a)中步驟4*所示)。隨著Micro-LED尺寸不斷縮小,對套刻精度的要求急劇提升,顯著增加了工藝難度與制造成本。

解決方案

提出的新型STO方法可規避傳統工藝中對高精度光刻與套刻對準的依賴,極大簡化了微米級像素器件的制造流程。如圖一(b)所示,該方法首先在p-GaN表面沉積一層1.2 微米厚的PECVD SiO2層,通過光刻與反應離子刻蝕圖形化實現預定義的像素結構。隨后,在空氣氣氛下于900°C退火2小時。SiO2在此過程中充當氧化掩模,有效阻擋氧氣擴散,保護其下方的LED結構并保留發光能力;而未被SiO2覆蓋的區域則被氧化并破壞,形成絕緣層,從而自然劃定出發光像素。SiO2圖形不僅決定了DUV Micro-LED的像素位置和尺寸,也在退火過程中實現了像素邊界的“自對準”界定。退火后,通過HF氣相去除SiO2掩模,再完成后續金屬電極的沉積與退火,從而形成完整器件結構。基于該工藝,研究團隊成功制造了2.3 微米像素的獨立式及陣列式DUV Micro-LED器件。通過掃描電鏡(SEM)、透射電鏡(TEM)以及陰極發光(CL)等表征手段,系統驗證了STO像素化機制的實現與空間分辨效果(如圖二所示)。

 

圖二.  (a) 像素陣列的SEM圖像;(b) 270 nm波長下的像素陣列CL圖像;(c) 像素界面的橫截面TEM圖像;(d) EDX測量的像素界面附近的氧元素分布。

器件性能

測試結果表明,該工藝制備的DUV Micro-LED具有良好的器件性能。例如,2.3 微米的獨立式DUV Micro-LED在10 A/cm2電流密度下呈現4.9 V較低的工作電壓。器件展現出良好的二極管特性和穩定的發光性能。所制造的2.3 微米的陣列式DUV Micro-LED在未經封裝條件下,on-wafer測量器件外量子效率為0.77%,在反向5V電壓下漏電流密度僅為4×10−7 A/cm2,表現出極大的性能潛力 (圖三)。

 

圖三.  像素尺寸為 2.3 微米的 DUV Micro-LED 陣列性能表征。(a) I-V 特性;(b) 0.4 至 50 mA 電流下的發射光譜;(c)光功率和 EQE 曲線。

團隊表示,選擇性熱氧化工藝在簡化Micro-LED像素化工藝的同時保持了良好的器件性能。相信這項工作將為深紫外Micro-LED制造帶來新的技術路徑,助力其在消毒滅菌、紫外通信、顏色轉換以及無掩膜光刻等關鍵應用中的推廣與發展。

參考文獻

Zhiyuan Liu, Haicheng Cao, Tingang Liu, Patsy A. Miranda Cortez, Zixian Jiang, Kexin Ren, Na Xiao, Yi Lu, Xiao Tang, Zuojian Pan, and Xiaohang Li, "2.3-μm deep UV micro-LEDs fabricated by self-aligned selective thermal oxidation process," Opt. Lett. 50, 3628-3631 (2025)

 (來源:KAUST先進半導體實驗室團隊)

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